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Código fuente

VCVTQQ2PS

Convertir Integers de Quadword Packed en coma flotante de precisión simple empacado

estableVMJITAOTinstruccion

Codificaciones

OpcodeInstruccionOp/En64 bitsCompat/LegacyDescripcion
EVEX.128.0F.W1 5B /rVCVTQQ2PS xmm1 {k1}{z}, xmm2/m128/m64bcstAValidoValidoConvertir dos enteros de cuádpago embalados de xmm2/mem AVX512DQ) OR a valores en coma flotante de precisión simple empaquetados en xmm1 AVX10.1 con máscara de escritura k1.
EVEX.256.0F.W1 5B /rVCVTQQ2PS xmm1 {k1}{z}, ymm2/m256/m64bcstAValidoValidoConvertir cuatro enteros de cuádpago de ymm2/mem AVX512DQ) OR a valores en coma flotante de precisión simple empaquetados en xmm1 AVX10.1 con máscara de escritura k1.
EVEX.512.0F.W1 5B /rVCVTQQ2PS ymm1 {k1}{z}, zmm2/m512/m64bcst {er}AValidoValidoConvertir ocho enteros de cuádpago de OR AVX10.1 zmm2/mem a ocho valores en coma flotante de precisión simple empaquetados en ymm1 con máscara de escritura k1.

Codificacion de operandos

Cada modo es un valor de la columna Op/En de arriba. Dice en que campo de la instruccion codificada va cada operando, en el orden en que se escriben, y si la instruccion lo lee, lo escribe o ambas cosas.

A

  1. modrm.reg escriturabyte ModRM, campo reg (bits 5-3)
  2. modrm.rm lecturabyte ModRM, campo r/m (bits 2-0); con el byte SIB y el desplazamiento cuando el campo mod los pide

Tupla: Full

Coste medido

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Descripción

Convierte los enteros de cuadripado en el operando de origen (segundo operando) para empaquetar los valores de punto flotante de precisión simple en el operando de destino (primer operando). El operando de origen es un registro ZMM/YMM/XMM o un 512/256/128-bit ubicación de memoria. La operación de destino es un YMM/XMM/XMM (más de 64 bits) registro actualizado condicionalmente con máscara de escritura k1. EVEX.vvvv está reservado y debe ser 1111b instrucciones de lo contrario #UD.

Operación

VCVTQQ2PS (EVEX Encoded Versions) When SRC Operand is a Register
(KL, VL) = (2, 128), (4, 256), (8, 512)

FOR j := 0 TO KL-1

i := j * 64

k := j * 32

IF k1[j] OR *no writemask*

     THEN DEST[k+31:k] :=

             Convert_QuadInteger_To_Single_Precision_Floating_Point(SRC[i+63:i])

     ELSE

             IF *merging-masking*              ; merging-masking

                 THEN *DEST[k+31:k] remains unchanged*

                 ELSE                          ; zeroing-masking

                    DEST[k+31:k] := 0

             FI

FI;

ENDFOR

DEST[MAXVL-1:VL/2] := 0


VCVTQQ2PS (EVEX Encoded Versions) When SRC Operand is a Memory Source
(KL, VL) = (2, 128), (4, 256), (8, 512)

FOR j := 0 TO KL-1

i := j * 64

k := j * 32

IF k1[j] OR *no writemask*

     THEN

             IF (EVEX.b == 1)

                  THEN

                    DEST[k+31:k] :=

             Convert_QuadInteger_To_Single_Precision_Floating_Point(SRC[63:0])

                  ELSE

                    DEST[k+31:k] :=

             Convert_QuadInteger_To_Single_Precision_Floating_Point(SRC[i+63:i])

             FI;

     ELSE

             IF *merging-masking*      ; merging-masking

                  THEN *DEST[k+31:k] remains unchanged*

                  ELSE                 ; zeroing-masking

                    DEST[k+31:k] := 0

             FI

FI;

ENDFOR

DEST[MAXVL-1:VL/2] := 0

Intel C/C++ compilador intrínseco

VCVTQQ2PS __m256 _mm512_cvtepi64_ps( __m512i a);
VCVTQQ2PS __m256 _mm512_mask_cvtepi64_ps( __m256 s, __mmask16 k, __m512i a);
VCVTQQ2PS __m256 _mm512_maskz_cvtepi64_ps( __mmask16 k, __m512i a);
VCVTQQ2PS __m256 _mm512_cvt_roundepi64_ps( __m512i a, int r);
VCVTQQ2PS __m256 _mm512_mask_cvt_roundepi_ps( __m256 s, __mmask8 k, __m512i a, int r);
VCVTQQ2PS __m256 _mm512_maskz_cvt_roundepi64_ps( __mmask8 k, __m512i a, int r);
VCVTQQ2PS __m128 _mm256_cvtepi64_ps( __m256i a);
VCVTQQ2PS __m128 _mm256_mask_cvtepi64_ps( __m128 s, __mmask8 k, __m256i a);
VCVTQQ2PS __m128 _mm256_maskz_cvtepi64_ps( __mmask8 k, __m256i a);
VCVTQQ2PS __m128 _mm_cvtepi64_ps( __m128i a);
VCVTQQ2PS __m128 _mm_mask_cvtepi64_ps( __m128 s, __mmask8 k, __m128i a);
VCVTQQ2PS __m128 _mm_maskz_cvtepi64_ps( __mmask8 k, __m128i a);

SIMD coma flotante Excepciones

Precision.

Otras excepciones

Instrucciones codificadas por EVEX, ver Tabla 2-48, "Tipo E2 Clase Condiciones de Excepción."

Additionally:

#UD                     If EVEX.vvvv != 1111B.

Fuentes