Vesta
中文
源代码

VCVTQQ2PD

将包装的四字整数转换为包装的 双精度浮点

stableVMJITAOTinstruction

编码

操作码指令Op/En64 位兼容/传统说明
EVEX.128.F3.0F.W1 E6 /rVCVTQQ2PD xmm1 {k1}{z}, xmm2/m128/m64bcstA有效有效将AVX512DQ)OR xmm2/m128/m64bcst的两个打包的四字整数转换成AVX10.1的双精度浮点值,在xmm1中用写作ask k1.
EVEX.256.F3.0F.W1 E6 /rVCVTQQ2PD ymm1 {k1}{z}, ymm2/m256/m64bcstA有效有效从AVX512DQ(或)ymm2/m256/m64bcst 到包装双精度AVX10.1 浮点值输入ymm1与写掩码 k1.
EVEX.512.F3.0F.W1 E6 /rVCVTQQ2PD zmm1 {k1}{z}, zmm2/m512/m64bcst {er}A有效有效将 OR AVX10.1 zmm2/m512/m64bcst 的8个打包四字整数转换为 zmm1 的8个 打包双精度浮点值 与 写掩码 k1.

操作数编码

每个模式对应上表 Op/En 列的一个取值，说明各操作数按书写顺序分别编码在指令的哪个字段，以及指令对它是读、是写还是两者兼有。

A

  1. modrm.reg escrituraModRM 字节的 reg 字段（第 5-3 位）
  2. modrm.rm lecturaModRM 字节的 r/m 字段（第 2-0 位）；当 mod 字段要求时，还包括 SIB 字节和位移

Tupla: Full

实测开销

正在从 arch-data 加载实测数据...

说明

将源操作数(第二个操作数)中包装的四字整数转换为目标操作数(第一个操作数)中包装的双精度浮点值.

源操作数是一个ZMM/YMM/XMM的登记册或512/256/128位内存位置. 目的地业务是ZMM/YMM/XMM的登记册,以写掩码k1有条件更新.

EVEX.vvvv是保留的,必须是1111b,否则指令会#UD.

行动

VCVTQQ2PD (EVEX2 Encoded Versions) When SRC Operand is a Register
(KL, VL) = (2, 128), (4, 256), (8, 512)
IF (VL == 512) AND (EVEX.b == 1)

    THEN
          SET_ROUNDING_MODE_FOR_THIS_INSTRUCTION(EVEX.RC);

    ELSE
          SET_ROUNDING_MODE_FOR_THIS_INSTRUCTION(MXCSR.RC);

FI;

FOR j := 0 TO KL-1

i := j * 64

IF k1[j] OR *no writemask*

     THEN DEST[i+63:i] :=

             Convert_QuadInteger_To_Double_Precision_Floating_Point(SRC[i+63:i])

     ELSE

             IF *merging-masking*                ; merging-masking

                 THEN *DEST[i+63:i] remains unchanged*

                 ELSE                            ; zeroing-masking

                    DEST[i+63:i] := 0

             FI

FI;

ENDFOR

DEST[MAXVL-1:VL] := 0


VCVTQQ2PD (EVEX Encoded Versions) when SRC Operand is a Memory Source

(KL, VL) = (2, 128), (4, 256), (8, 512)

FOR j := 0 TO KL-1

i := j * 64

IF k1[j] OR *no writemask*

     THEN

             IF (EVEX.b == 1)

                  THEN

                    DEST[i+63:i] :=

             Convert_QuadInteger_To_Double_Precision_Floating_Point(SRC[63:0])

                  ELSE

                    DEST[i+63:i] :=

             Convert_QuadInteger_To_Double_Precision_Floating_Point(SRC[i+63:i])

             FI;

     ELSE

             IF *merging-masking*        ; merging-masking

                  THEN *DEST[i+63:i] remains unchanged*

                  ELSE                   ; zeroing-masking

                    DEST[i+63:i] := 0

             FI

FI;

ENDFOR

DEST[MAXVL-1:VL] := 0

Intel C/C++ 内在编译器

VCVTQQ2PD __m512d _mm512_cvtepi64_pd( __m512i a);
VCVTQQ2PD __m512d _mm512_mask_cvtepi64_pd( __m512d s, __mmask16 k, __m512i a);
VCVTQQ2PD __m512d _mm512_maskz_cvtepi64_pd( __mmask16 k, __m512i a);
VCVTQQ2PD __m512d _mm512_cvt_roundepi64_pd( __m512i a, int r);
VCVTQQ2PD __m512d _mm512_mask_cvt_roundepi64_pd( __m512d s, __mmask8 k, __m512i a, int r);
VCVTQQ2PD __m512d _mm512_maskz_cvt_roundepi64_pd( __mmask8 k, __m512i a, int r);
VCVTQQ2PD __m256d _mm256_mask_cvtepi64_pd( __m256d s, __mmask8 k, __m256i a);
VCVTQQ2PD __m256d _mm256_maskz_cvtepi64_pd( __mmask8 k, __m256i a);
VCVTQQ2PD __m128d _mm_mask_cvtepi64_pd( __m128d s, __mmask8 k, __m128i a);
VCVTQQ2PD __m128d _mm_maskz_cvtepi64_pd( __mmask8 k, __m128i a);

SIMD 浮点 例外

Precision.

其他例外

EVEX-encoded 指令,参见表2-48,"Type E2 Class Exception Centers".

Additionally:

#UD                     If EVEX.vvvv != 1111B.

来源