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源代码

VFMSUB132PD, VFMSUB213PD, VFMSUB231PD

包件的倍减法

stableVMJITAOTinstruction

编码

操作码指令Op/En64 位兼容/传统说明
VEX.128.66.0F38.W1 9A /rVFMSUB132PD xmm1, xmm2, xmm3/m128A有效有效从 xmm1 和 xmm3/ mem 中乘以 打包双精度浮点值 ,减去 xmm2 ,结果为 xmm1 .
VEX.128.66.0F38.W1 AA /rVFMSUB213PD xmm1, xmm2, xmm3/m128A有效有效从 xmm1 和 xmm2 中乘以 打包双精度浮点值,减去 xmm3/mem,结果为 xmm1.
VEX.128.66.0F38.W1 BA /rVFMSUB231PD xmm1, xmm2, xmm3/m128A有效有效从 xmm2 和 xmm3/ mem 中乘以 打包双精度浮点值 ,减去 xmm1 ,结果为 xmm1 .
VEX.256.66.0F38.W1 9A /rVFMSUB132PD ymm1, ymm2, ymm3/m256A有效有效从 ymm1 和 ymm3/ mem 中乘以 打包双精度浮点值 ,减去 ymm2 ,结果为 ymm1 .
VEX.256.66.0F38.W1 AA /rVFMSUB213PD ymm1, ymm2, ymm3/m256A有效有效从 ymm1 和 ymm2 中乘以 打包双精度浮点值,减去 ymm3/mem,结果为 ymm1.
VEX.256.66.0F38.W1 BA /rVFMSUB231PD ymm1, ymm2, ymm3/m256A有效有效从 ymm2 和 ymm3/ mem 中乘以 打包双精度浮点值 ,减去 ymm1 ,结果为 ymm1.S
EVEX.128.66.0F38.W1 9A /rVFMSUB132PD xmm1 {k1}{z}, xmm2, xmm3/m128/m64bcstB有效有效从 xmm1 和 xmm3/m128/m64bcst 乘以包装的 双精度浮点 AVX512F) OR值,AVX10.1 减去 xmm2 ,并得出 xmm1 受写掩码 和 k1 约束.
EVEX.128.66.0F38.W1 AA /rVFMSUB213PD xmm1 {k1}{z}, xmm2, xmm3/m128/m64bcstB有效有效乘以包装的双精度浮点AVX512F) OR值来自xmm1和xmm2,减去AVX10.1 xmm3/m128/m64bcst,并得出xmm1的标注,以写作k1.
EVEX.128.66.0F38.W1 BA /rVFMSUB231PD xmm1 {k1}{z}, xmm2, xmm3/m128/m64bcstB有效有效从 xmm2 和 xmm3/m128/m64bcst 乘以包装的 双精度浮点 AVX512F) OR值,AVX10.1 减去 xmm1 ,并得出 xmm1 受写掩码 和 k1 约束.
EVEX.256.66.0F38.W1 9A /rVFMSUB132PD ymm1 {k1}{z}, ymm2, ymm3/m256/m64bcstB有效有效从 ymm1 和 ymm3/m256/m64bcst 乘以包装的 双精度浮点 AVX512F) OR值,AVX10.1 减去 ymm2 ,并得出 ymm1 受写掩码 和 k1 约束.
EVEX.256.66.0F38.W1 AA /rVFMSUB213PD ymm1 {k1}{z}, ymm2, ymm3/m256/m64bcstB有效有效乘以包装的双精度浮点AVX512F) OR值来自ymm1和ymm2,减去AVX10.1 ymm3/m256/m64bcst,并得出ymm1的标注,以写作k1.
EVEX.256.66.0F38.W1 BA /rVFMSUB231PD ymm1 {k1}{z}, ymm2, ymm3/m256/m64bcst Opcode/ InstructionB有效有效将 双精度浮点 AVX512F 的 OR 值乘以 ymm2 和 ymm3/m256 / m64bcst, AVX10.1 减去 ymm1 , 并生成 ymm1 , 以 写掩码 和 k1 为条件。 Op/64/3 2 CPUID Feaa Ture 描述 En 位为 Supp 模式旗 。
EVEX.512.66.0F38.W1 9A /rVFMSUB132PD zmm1 {k1}{z}, zmm2, zmm3/m512/m64bcst{er}b v有效从 zmm1 和 zmm3/m512/m64bcst 中乘以包装的双精度浮点 OR AVX10. 1 值,减去 zmm2 ,并将结果放入 zmm1 中,按写作 k1 。
EVEX.512.66.0F38.W1 AA /rVFMSUB213PD zmm1 {k1}{z}, zmm2, zmm3/m512/m64bcst{er}b v有效乘积双精度浮点OR AVX10. 1值从zmm1和zmm2,减去zmm3/m512/m64bcst,并将结果放入zmm1,以写作k1.
EVEX.512.66.0F38.W1 BA /rVFMSUB231PD zmm1 {k1}{z}, zmm2, zmm3/m512/m64bcst{er}b v有效从 zmm2 和 zmm3/m512/m64bcst 中乘以包装的双精度浮点 OR AVX10. 1 值,减去 zmm1 ,并将结果放入 zmm1 中,按写作 k1 。

操作数编码

每个模式对应上表 Op/En 列的一个取值，说明各操作数按书写顺序分别编码在指令的哪个字段，以及指令对它是读、是写还是两者兼有。

A

  1. modrm.reg lectura y escrituraModRM 字节的 reg 字段（第 5-3 位）
  2. vex.vvvv lecturaVEX 前缀的 vvvv 字段（按位取反）
  3. modrm.rm lecturaModRM 字节的 r/m 字段（第 2-0 位）；当 mod 字段要求时，还包括 SIB 字节和位移

B

  1. modrm.reg lectura y escrituraModRM 字节的 reg 字段（第 5-3 位）
  2. evex.vvvv lecturaEVEX 前缀的 vvvv 字段（按位取反）
  3. modrm.rm lecturaModRM 字节的 r/m 字段（第 2-0 位）；当 mod 字段要求时，还包括 SIB 字节和位移

Tupla: Full

实测开销

正在从 arch-data 加载实测数据...

说明

使用三个 源操作数 在 打包双精度浮点值 上执行一组 SIMD 乘积-负积计算,并在 目标操作数 中写入乘积-负积结果. 目标操作数亦为第一源操作数. 第二个操作数必须是SIMD的登记册. 第三个源操作数可以是SIMD寄存器或内存位置.

VFMSUB132PD : (英语). 将两个,四个或八个打包双精度浮点值从第一源操作数乘以两个,第三个源操作数中的四个或八个打包双精度浮点值乘以两个. 从无限精度中间结果中减去第二源操作数中的2,4或8个打包双精度浮点值,进行四舍五入,并将所产生的2,4或8个打包双精度浮点值存储到目标操作数(第一源操作数).

VFMSUB213PD : (英语). 将2,4或8个打包双精度浮点值从第二源操作数乘以2,4或8个打包双精度浮点值在第一源操作数. 从无限精度中间结果中减去第三源操作数中两个,四个或八个包装的双精度浮点值,进行四舍五入,并将所产生的两个,四个或八个打包双精度浮点值存储到目标操作数(第一源操作数).

VFMSUB231PD : (英语). 将2,4或8个打包双精度浮点值从第二个来源乘以2,4或8个打包双精度浮点值在第三个源操作数. 从无限精度中间结果中减去第一源操作数中的2,4或8个打包双精度浮点值,进行四舍五入,并将所产生的2,4或8个打包双精度浮点值存储到目标操作数(第一源操作数).

EVEX 编码版本 : 目标操作数(也是第一源操作数)和第二源操作数是ZMM/YMM/XMM登记册. 第三个源操作数是一个ZMM/YMM/XMM注册,一个512/256/128位内存位置或512/256/128位矢量从一个64位内存位置广播. 目标操作数是有条件更新的,带有写面具k1.

VEX.256 编码版本 : 目标操作数(也是第一源操作数)是一个YMM的注册,并在reg field中编码. 第二源操作数是一个YMM的寄存器,编码为VEX.vvvv. 第三个源操作数是一个YMM寄存器或256位内存位置,并在rm field中编码.

VEX.128 编码版本 : 目标操作数(也是第一源操作数)是一个XMM的注册,并在reg field中编码. 第二源操作数是一个XMM的寄存器,编码为VEX.vvvv. 第三个源操作数是一个XMM寄存器或128位内存位置,并在rm field中编码. YMM目的地的上方128位注册被清零.

行动

In the operations below, "*" and "-" symbols represent multiplication and subtraction with infinite precision inputs and outputs (no
rounding).

VFMSUB132PD DEST, SRC2, SRC3 (VEX Encoded Versions)
IF (VEX.128) THEN

    MAXNUM := 2
ELSEIF (VEX.256)

    MAXNUM := 4
FI
For i = 0 to MAXNUM-1 {

    n := 64*i;
    DEST[n+63:n] := RoundFPControl_MXCSR(DEST[n+63:n]*SRC3[n+63:n] - SRC2[n+63:n])
}
IF (VEX.128) THEN
    DEST[MAXVL-1:128] := 0
ELSEIF (VEX.256)
    DEST[MAXVL-1:256] := 0
FI

VFMSUB213PD DEST, SRC2, SRC3 (VEX Encoded Versions)
IF (VEX.128) THEN

    MAXNUM := 2
ELSEIF (VEX.256)

    MAXNUM := 4
FI
For i = 0 to MAXNUM-1 {

    n := 64*i;
    DEST[n+63:n] := RoundFPControl_MXCSR(SRC2[n+63:n]*DEST[n+63:n] - SRC3[n+63:n])
}
IF (VEX.128) THEN
    DEST[MAXVL-1:128] := 0
ELSEIF (VEX.256)
    DEST[MAXVL-1:256] := 0
FI

VFMSUB231PD DEST, SRC2, SRC3 (VEX Encoded Versions)
IF (VEX.128) THEN

    MAXNUM := 2
ELSEIF (VEX.256)

    MAXNUM := 4
FI
For i = 0 to MAXNUM-1 {

    n := 64*i;
    DEST[n+63:n] := RoundFPControl_MXCSR(SRC2[n+63:n]*SRC3[n+63:n] - DEST[n+63:n])
}
IF (VEX.128) THEN
    DEST[MAXVL-1:128] := 0
ELSEIF (VEX.256)
    DEST[MAXVL-1:256] := 0
FI

VFMSUB132PD DEST, SRC2, SRC3 (EVEX Encoded Versions, When SRC3 Operand is a Register)
(KL, VL) = (2, 128), (4, 256), (8, 512)


IF (VL = 512) AND (EVEX.b = 1)

     THEN

          SET_ROUNDING_MODE_FOR_THIS_INSTRUCTION(EVEX.RC);

     ELSE

          SET_ROUNDING_MODE_FOR_THIS_INSTRUCTION(MXCSR.RC);

FI;

FOR j := 0 TO KL-1

     i := j * 64

     IF k1[j] OR *no writemask*

          THEN DEST[i+63:i] :=

                  RoundFPControl(DEST[i+63:i]*SRC3[i+63:i] - SRC2[i+63:i])

          ELSE

                  IF *merging-masking*     ; merging-masking

                       THEN *DEST[i+63:i] remains unchanged*

                       ELSE                ; zeroing-masking

                        DEST[i+63:i] := 0

                  FI

     FI;

ENDFOR

DEST[MAXVL-1:VL] := 0

VFMSUB132PD DEST, SRC2, SRC3 (EVEX Encoded Versions, When SRC3 Operand is a Memory Source)
(KL, VL) = (2, 128), (4, 256), (8, 512)

FOR j := 0 TO KL-1

     i := j * 64

     IF k1[j] OR *no writemask*

          THEN

                  IF (EVEX.b = 1)

                       THEN

                        DEST[i+63:i] :=

                  RoundFPControl_MXCSR(DEST[i+63:i]*SRC3[63:0] - SRC2[i+63:i])

                       ELSE

                        DEST[i+63:i] :=

                  RoundFPControl_MXCSR(DEST[i+63:i]*SRC3[i+63:i] - SRC2[i+63:i])

                  FI;

                  ELSE

                  IF *merging-masking*     ; merging-masking

                       THEN *DEST[i+63:i] remains unchanged*

                       ELSE                ; zeroing-masking

                        DEST[i+63:i] := 0

                  FI

     FI;

ENDFOR

DEST[MAXVL-1:VL] := 0


VFMSUB213PD DEST, SRC2, SRC3 (EVEX Encoded Versions, When SRC3 Operand is a Register)

(KL, VL) = (2, 128), (4, 256), (8, 512)

IF (VL = 512) AND (EVEX.b = 1)

     THEN

          SET_ROUNDING_MODE_FOR_THIS_INSTRUCTION(EVEX.RC);

     ELSE

          SET_ROUNDING_MODE_FOR_THIS_INSTRUCTION(MXCSR.RC);

FI;

FOR j := 0 TO KL-1

     i := j * 64

     IF k1[j] OR *no writemask*

          THEN DEST[i+63:i] :=

                  RoundFPControl(SRC2[i+63:i]*DEST[i+63:i] - SRC3[i+63:i])

          ELSE

                  IF *merging-masking*    ; merging-masking

                       THEN *DEST[i+63:i] remains unchanged*

                       ELSE               ; zeroing-masking

                       DEST[i+63:i] := 0

                  FI

     FI;

ENDFOR

DEST[MAXVL-1:VL] := 0

VFMSUB213PD DEST, SRC2, SRC3 (EVEX Encoded Versions, When SRC3 Operand is a Memory Source)
(KL, VL) = (2, 128), (4, 256), (8, 512)

FOR j := 0 TO KL-1

     i := j * 64

     IF k1[j] OR *no writemask*

          THEN

                  IF (EVEX.b = 1)

                       THEN

                       DEST[i+63:i] :=

                  RoundFPControl_MXCSR(SRC2[i+63:i]*DEST[i+63:i] - SRC3[63:0])

+31:i])

                       ELSE

                       DEST[i+63:i] :=

                  RoundFPControl_MXCSR(SRC2[i+63:i]*DEST[i+63:i] - SRC3[i+63:i])

                  FI;

          ELSE

                  IF *merging-masking*    ; merging-masking

                       THEN *DEST[i+63:i] remains unchanged*

                       ELSE               ; zeroing-masking

                       DEST[i+63:i] := 0

                  FI

     FI;

ENDFOR

DEST[MAXVL-1:VL] := 0


VFMSUB231PD DEST, SRC2, SRC3 (EVEX Encoded Versions, When SRC3 Operand is a Register)

(KL, VL) = (2, 128), (4, 256), (8, 512)

IF (VL = 512) AND (EVEX.b = 1)

     THEN

          SET_ROUNDING_MODE_FOR_THIS_INSTRUCTION(EVEX.RC);

     ELSE

          SET_ROUNDING_MODE_FOR_THIS_INSTRUCTION(MXCSR.RC);

FI;

FOR j := 0 TO KL-1

     i := j * 64

     IF k1[j] OR *no writemask*

          THEN DEST[i+63:i] :=

                  RoundFPControl(SRC2[i+63:i]*SRC3[i+63:i] - DEST[i+63:i])

          ELSE

                  IF *merging-masking*    ; merging-masking

                       THEN *DEST[i+63:i] remains unchanged*

                       ELSE               ; zeroing-masking

                       DEST[i+63:i] := 0

                  FI

     FI;

ENDFOR

DEST[MAXVL-1:VL] := 0

VFMSUB231PD DEST, SRC2, SRC3 (EVEX Encoded Versions, When SRC3 Operand is a Memory Source)
(KL, VL) = (2, 128), (4, 256), (8, 512)

FOR j := 0 TO KL-1

     i := j * 64

     IF k1[j] OR *no writemask*

          THEN

                  IF (EVEX.b = 1)

                       THEN

                       DEST[i+63:i] :=

                  RoundFPControl_MXCSR(SRC2[i+63:i]*SRC3[63:0] - DEST[i+63:i])

                       ELSE

                       DEST[i+63:i] :=

                  RoundFPControl_MXCSR(SRC2[i+63:i]*SRC3[i+63:i] - DEST[i+63:i])

                  FI;

          ELSE

                  IF *merging-masking*    ; merging-masking

                       THEN *DEST[i+63:i] remains unchanged*

                       ELSE               ; zeroing-masking

                       DEST[i+63:i] := 0

                  FI

     FI;

ENDFOR

DEST[MAXVL-1:VL] := 0

Intel C/C++ 内在编译器

VFMSUBxxxPD __m512d _mm512_fmsub_pd(__m512d a, __m512d b, __m512d c);
VFMSUBxxxPD __m512d _mm512_fmsub_round_pd(__m512d a, __m512d b, __m512d c, int r);
VFMSUBxxxPD __m512d _mm512_mask_fmsub_pd(__m512d a, __mmask8 k, __m512d b, __m512d c);
VFMSUBxxxPD __m512d _mm512_maskz_fmsub_pd(__mmask8 k, __m512d a, __m512d b, __m512d c);
VFMSUBxxxPD __m512d _mm512_mask3_fmsub_pd(__m512d a, __m512d b, __m512d c, __mmask8 k);
VFMSUBxxxPD __m512d _mm512_mask_fmsub_round_pd(__m512d a, __mmask8 k, __m512d b, __m512d c, int r);
VFMSUBxxxPD __m512d _mm512_maskz_fmsub_round_pd(__mmask8 k, __m512d a, __m512d b, __m512d c, int r);
VFMSUBxxxPD __m512d _mm512_mask3_fmsub_round_pd(__m512d a, __m512d b, __m512d c, __mmask8 k, int r);
VFMSUBxxxPD __m256d _mm256_mask_fmsub_pd(__m256d a, __mmask8 k, __m256d b, __m256d c);
VFMSUBxxxPD __m256d _mm256_maskz_fmsub_pd(__mmask8 k, __m256d a, __m256d b, __m256d c);
VFMSUBxxxPD __m256d _mm256_mask3_fmsub_pd(__m256d a, __m256d b, __m256d c, __mmask8 k);
VFMSUBxxxPD __m128d _mm_mask_fmsub_pd(__m128d a, __mmask8 k, __m128d b, __m128d c);
VFMSUBxxxPD __m128d _mm_maskz_fmsub_pd(__mmask8 k, __m128d a, __m128d b, __m128d c);
VFMSUBxxxPD __m128d _mm_mask3_fmsub_pd(__m128d a, __m128d b, __m128d c, __mmask8 k);
VFMSUBxxxPD __m128d _mm_fmsub_pd (__m128d a, __m128d b, __m128d c);
VFMSUBxxxPD __m256d _mm256_fmsub_pd (__m256d a, __m256d b, __m256d c);

SIMD 浮点 例外

Overflow, Underflow, Invalid, Precision, Denormal.

其他例外

VEX-encoded指令,参见表2-19"第2类例外条件".

EVEX-encoded 指令,参见表2-48,"Type E2 Class Exception Centers".

来源