Vesta
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Código fuente

VSCALEFPH

Valores Scale Packed FP16 con valores FP16

estableVMJITAOTinstruccion

Codificaciones

OpcodeInstruccionOp/En64 bitsCompat/LegacyDescripcion
EVEX.128.66.MAP6.W0 2C /rVSCALEFPH xmm1{k1}{z}, xmm2, xmm3/m128/m16bcstAValidoValidoEscalar los valores de FP16 empaquetados en xmm2 utilizando los valores AND AVX512VL) de xmm3/m128/m16bcst, y almacenar OR AVX10.1 el resultado en xmm1 sujeto a máscara de escritura k1.
EVEX.256.66.MAP6.W0 2C /rVSCALEFPH ymm1{k1}{z}, ymm2, ymm3/m256/m16bcstAValidoValidoEscalar los valores de FP16 empaquetados en ymm2 utilizando los valores AND AVX512VL) de ymm3/m256/m16bcst, y almacenar el resultado OR AVX10.1 en ymm1 sujeto a máscara de escritura k1.
EVEX.512.66.MAP6.W0 2C /rVSCALEFPH zmm1{k1}{z}, zmm2, zmm3/m512/m16bcst {er}AValidoValidoEscalar los valores de FP16 empaquetados en zmm2 utilizando los valores OR AVX10.1 de zmm3/m512/m16bcst, y almacenar el resultado en zmm1 sujeto a máscara de escritura k1.

Codificacion de operandos

Cada modo es un valor de la columna Op/En de arriba. Dice en que campo de la instruccion codificada va cada operando, en el orden en que se escriben, y si la instruccion lo lee, lo escribe o ambas cosas.

A

  1. modrm.reg escriturabyte ModRM, campo reg (bits 5-3)
  2. vex.vvvv lecturaprefijo VEX, campo vvvv (invertido)
  3. modrm.rm lecturabyte ModRM, campo r/m (bits 2-0); con el byte SIB y el desplazamiento cuando el campo mod los pide

Tupla: Full

Coste medido

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Descripción

Esta instrucción realiza escala una coma flotante de los valores de FP16 empaquetados en el primer operando de origen multiplicando por 2 al poder de los valores FP16 en segundo operando de origen. Los elementos de destino se actualizan según la máscara de escritura.

La ecuación de esta operación es dada por:

     zmm1 := zmm2 * 2floor(zmm3).

Planta (zmm3) significa valor máximo entero zmm3.

Si el resultado no puede ser representado en FP16, entonces se publica la respuesta de desbordamiento adecuada (para el escalado positivo operando), o la respuesta de subida adecuada (para el escalado negativo operando). Las respuestas de desbordamiento y desbordamiento dependen del modo de redondeo (para redondeo compatible con IEEE), así como de otros ajustes en MXCSR (fotos de máscara de visualización), y en el bit SAE.

En el cuadro 5-39 y el cuadro 5-40 figuran valores de entrada especiales.

Casos especiales de VSCALEFPH/VSCALEFSH

+/-QNaNQNaN(Src1)+INF+0QNaN(Src1)IF o fuente es SNan
+/-SNaNQNaN(Src1)QNaN(Src1)QNaN(Src1)QNaN(Src1)YES
+/-INFQNaN(Src2)Src1QNaN_IndefiniteSrc1IF Src2 es SNaN o -INF
+/-0QNaN(Src2)QNaN_IndefiniteSrc1Src1IF Src2 es SNaN o +INF

Operación

def scale_fp16(src1,src2):

    tmp1 := src1
    tmp2 := src2
    return tmp1 * POW(2, FLOOR(tmp2))

VSCALEFPH dest{k1}, src1, src2
VL = 128, 256, or 512
KL := VL / 16

IF (VL = 512) AND (EVEX.b = 1) and no memory operand:
    SET_RM(EVEX.RC)

ELSE
    SET_RM(MXCSR.RC)

FOR i := 0 to KL-1:
    IF k1[i] or *no writemask*:
          IF SRC2 is memory and (EVEX.b = 1):
                tsrc := src2.fp16[0]
          ELSE:
                tsrc := src2.fp16[i]
          dest.fp16[i] := scale_fp16(src1.fp16[i],tsrc)
    ELSE IF *zeroing*:
          dest.fp16[i] := 0
    //else dest.fp16[i] remains unchanged

DEST[MAXVL-1:VL] := 0

Intel C/C++ compilador intrínseco

VSCALEFPH __m128h _mm_mask_scalef_ph (__m128h src, __mmask8 k, __m128h a, __m128h b);
VSCALEFPH __m128h _mm_maskz_scalef_ph (__mmask8 k, __m128h a, __m128h b);
VSCALEFPH __m128h _mm_scalef_ph (__m128h a, __m128h b);
VSCALEFPH __m256h _mm256_mask_scalef_ph (__m256h src, __mmask16 k, __m256h a, __m256h b);
VSCALEFPH __m256h _mm256_maskz_scalef_ph (__mmask16 k, __m256h a, __m256h b);
VSCALEFPH __m256h _mm256_scalef_ph (__m256h a, __m256h b);
VSCALEFPH __m512h _mm512_mask_scalef_ph (__m512h src, __mmask32 k, __m512h a, __m512h b);
VSCALEFPH __m512h _mm512_maskz_scalef_ph (__mmask32 k, __m512h a, __m512h b);
VSCALEFPH __m512h _mm512_scalef_ph (__m512h a, __m512h b);
VSCALEFPH __m512h _mm512_mask_scalef_round_ph (__m512h src, __mmask32 k, __m512h a, __m512h b, const int rounding);
VSCALEFPH __m512h _mm512_scalef_round_ph (__m512h a, __m512h b, const int rounding);

SIMD coma flotante Excepciones

Overflow, Underflow, Invalid, Precision, Denormal (for Src1).

Denormal no se reporta para Src2.

Otras excepciones

Instrucciones codificadas por EVEX, ver Tabla 2-48, "Tipo E2 Clase Condiciones de Excepción".

Fuentes